¿Cuántas series de ESP32 existen actualmente?

Actualmente, el ecosistema de Espressif cuenta con 12 series principales: ESP32 clásico, ESP32-S2, ESP32-S3, ESP32-S31, ESP32-C2, ESP32-C3, ESP32-C5, ESP32-C6, ESP32-C61, ESP32-P4, ESP32-H2 y ESP32-H4.

¿Cuáles son las series más recientes de Espressif?

Las series más recientes incluyen el ESP32-P4 (enfocado en alto rendimiento con dual-core RISC-V a 400 MHz), el ESP32-C5 (primer chip con Wi-Fi de doble banda 2.4/5 GHz de Espressif) y el ESP32-C61 (Wi-Fi 6 y Bluetooth 6 de bajo costo).

RISC-V dual-core de 32 bits con extensiones vectoriales

ESP32-S31

Procesador dual-core RISC-V de alto rendimiento a 320MHz con Wi-Fi 6, Bluetooth 5.4 y Classic, Zigbee/Thread, Matter y aceleración de IA

Datasheet oficial Guía de programación Manual de referencia técnica

Procesador: Dual-core; Hasta 320 MHz
SRAM: 512 KB (HP SRAM); + 32 KB LP SRAM de SRAM RTC
GPIO: 60; pines programables
Arquitectura: RISC-V; RISC-V dual-core de 32 bits con extensiones vectoriales

Documentación preliminar

Anunciado por Espressif; especificaciones sujetas a revisión final en la hoja de datos comercial

Kit de desarrollo oficial

Placa estándar de Espressif para la serie ESP32-S31.

Pines con restricción de uso

No todos los pines del ESP32-S31 están libres para uso general. 13 de ellos tienen alguna condición: ya están ocupados por memoria, se leen durante el arranque o solo funcionan como entrada. Conviene comprobarlos antes de cerrar el esquemático.

Conectados a la memoria flash/PSRAM

6 pines

SPICS
SPIQ
SPIWP
SPIHD
SPICLK
SPID

Ya están conectados a la memoria desde donde se lee el firmware. Usarlos como GPIO común normalmente bloquea el chip o corrompe la ejecución. En módulos con flash interna ni siquiera llegan a los pines del encapsulado.

Strapping (modo de arranque)

2 pines

GPIO60
GPIO61

El chip lee el nivel lógico de estos pines en el instante del reset para decidir cómo inicializarse. Pueden usarse después del arranque, pero el circuito externo no debe forzar el nivel incorrecto durante el reset, de lo contrario la placa no iniciará o entrará en modo de descarga inesperadamente.

Grabación y depuración

4 pines

GPIO54
GPIO55
GPIO56
GPIO57

Son la UART de grabación y las líneas de JTAG. Siguen utilizables como GPIO, pero al reutilizarlos pierde la posibilidad de grabar y depurar la placa sin desconectar lo que esté conectado allí.

No deben quedar flotando

1 pin

CHIP_PU

Requieren un nivel lógico definido por hardware: pull-up externo o circuito RC de retardo. Dejarlos sueltos causa reinicios aleatorios o un arranque inestable.

Estos grupos proceden de los mismos datos que el diagrama de conexiones. Allí podrá consultar pino a pino todas las funciones, el dominio de alimentación y los avisos completos.

Abrir diagrama de pines

Procesador

Arquitectura: RISC-V dual-core de 32 bits con extensiones vectoriales
Núcleos: 2 (Dual-core)
Frecuencia: Hasta 320 MHz
Coprocesador ULP: Sí (RISC-V ULP de ultra bajo consumo)
Aceleradores de IA: Sí (extensiones vectoriales avanzadas para TinyML, reconocimiento de voz y visión)

Conectividad

Wi-Fi: Wi-Fi 6 (802.11ax) 2.4 GHz (retrocompatible con 802.11b/g/n, soporte a OFDMA y TWT)
Bluetooth: Bluetooth 5.4 LE y Bluetooth Classic (BR/EDR)
Zigbee/Thread: IEEE 802.15.4 (Zigbee 3.0 y Thread 1.3)
Matter: Sí (soporte completo como terminal o Matter Bridge)
Ethernet: No
CAN: Sim (CAN FD Controller)

Herramientas y disponibilidad

ESP-IDF mínimo: ESP-IDF v5.4+
Core Arduino: En desarrollo (previsto tras la maduración en ESP-IDF)
Depuración: USB Serial/JTAG integrado y JTAG externo
Encapsulado: QFN y BGA
Módulos disponibles: ESP32-S31-WROOM, módulos integrados previstos para 2026

Seguridad

AES: AES-128/256 com GCM
SHA: SHA-1/224/256/384/512
RSA / MPI: Sí (RSA-3072/4096)
ECC (curvas elípticas): Sí (ECC HW)
ECDSA en hardware: Sí (ECDSA HW)
HMAC: Sí
Firma digital (DS): Sí (Digital Signature peripheral)
Key Manager: Sí (Key Manager integrado con eFuse)
Generador aleatorio (TRNG): Sí (TRNG)
Cifrado de flash: Sí (XTS-AES-128/256)
Secure Boot: V2 (RSA-3072, ECDSA P-256/384)
Protección contra DPA: Sí (resistencia DPA de hardware)

Memoria

SRAM: 512 KB (HP SRAM)
SRAM RTC: 32 KB LP SRAM
ROM: 512 KB
Flash externa: Hasta 1 GB vía Octal SPI (soporte para Flash OPI de alta velocidad)
PSRAM externa: Hasta 1 GB vía Octal SPI (PSRAM OPI de alto ancho de banda)

Consumo de energía

Valores típicos a 3,3 V y 25 °C. El consumo real depende del ciclo de trabajo de la radio y de la frecuencia de reloj configurada.

Modo activo: Consumo optimizado de alto rendimiento configurable
Light Sleep: 0.1-0.8 mA
Deep Sleep: Baixo consumo com LP CPU ativa

Periféricos

GPIO: 60
ADC: 2x SAR ADC de 12 bits, hasta 20 canales
DAC: No
Touch: 14 canales capacitivos táctiles
UART: 5 (4 UART + 1 LP UART)
SPI: SPI, QSPI, OPI (múltiples controladores)
I2C: 3 (2 I2C + 1 LP I2C)
I2S: 2
PWM: LED PWM y MCPWM para control avanzado de motores
USB: USB OTG 1.1 Full-Speed y USB Serial/JTAG integrado

Interfaces especiales

LCD: Interfaz de display RGB paralelo y MIPI DSI
Cámara: Interfaz de cámara paralela DVP / MIPI CSI
SDIO: 1 (SDIO Host 3.0)
Sensor Hall: No
Sensor de temperatura: Sí (sensor de temperatura integrado)

Límites de temperatura

Operación: -40°C a 85°C
Almacenamiento: -40°C a 150°C

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